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ADT7490
Table 44. ADT7490 REGISTERS (continued)
Addr
0x62
0x63
0x64
0x65
0x66
0x67
0x68
0x69
0x6A
0x6B
0x6C
0x6D
0x6E
0x6F
0x70
0x71
0x72
0x73
0x74
0x75
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
R/W
Desc
Enhanced
Acoustics
Reg. 1
Enhanced
Acoustics
Reg. 2
PWM1
Min Duty
Cycle
PWM2
Min Duty
Cycle
PWM3
Min Duty
Cycle
Remote 1
Temp.
T MIN
Local
Temp.
T MIN
Remote 2
Temp.
T MIN
R emote 1
THERM
Temp.
Limit
Local
THERM
Temp.
Limit
R emote 2
THERM
Temp.
Limit
Remote 1
and Local
Temp./
T MIN
Hysteresis
Remote 2
and PECI
Temp./
T MIN
Hysteresis
XNOR
Tree Test
Enable
Remote 1
Temp
Offset
Local
Temp.
Offset
Remote 2
Temp.
Offset
Config.
Reg. 2
Interrupt
Mask
Reg. 1
Interrupt
Mask
Reg. 2
Bit 7
MIN3
EN2
7
7
7
7
7
7
7
7
7
HYSR1
HYSR2
RES
7
7
7
Shutdo
wn
OOL
D2
FAULT
Bit 6
MIN2
ACOU2
6
6
6
6
6
6
6
6
6
HYSR1
HYSR2
RES
6
6
6
CONV
R2T
D1
FAULT
Bit 5
MIN1
ACOU2
5
5
5
5
5
5
5
5
5
HYSR1
HYSR2
RES
5
5
5
ATTN
LT
FAN4/
THERM
Bit 4
SYNC
ACOU2
4
4
4
4
4
4
4
4
4
HYSR1
HYSR2
RES
4
4
4
AVG
R1T
FAN3
Bit 3
EN1
EN3
3
3
3
3
3
3
3
3
3
HYSL
HYSP
RES
3
3
3
Fan3
Detect
+5V IN
FAN2
Bit 2
ACOU
ACOU3
2
2
2
2
2
2
2
2
2
HYSL
HYSP
RES
2
2
2
Fan2
Detect
V CC
FAN1
Bit 1
ACOU
ACOU3
1
1
1
1
1
1
1
1
1
HYSL
HYSP
RES
1
1
1
Fan1
Detect
V CCP
OOL
Bit 0
ACOU
ACOU3
0
0
0
0
0
0
0
0
0
HYSL
HYSP
XEN
0
0
0
Fan
PresDT
+2.5V IN /
THERM
+12V IN /
VC
De-
fault
0x00
0x00
0x80
0x80
0x80
0x5A
0x5A
0x5A
0x64
0x64
0x64
0x44
0x44
0x00
0x00
0x00
0x00
0x00
0x00
0x00
Lock-
able
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
Yes
?
?
http://onsemi.com
46
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